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CY2305SXC-1HT 概述如下:
该CY2309是设计成一种低成本3.3V零延迟缓冲器分配高速时钟,并采用16引脚SOIC或TSSOP封装。该CY2305是的8
引脚版本CY2309 。它接受一个参考输入,并驱动了5低偏移时钟。每个器件的-1H版本在向上操作以100- / 133
MHz的频率,并具有传动比更高-1设备。所有部件具有片上PLL的哪个锁定到输入时钟REF引脚。 PLL反馈是在芯
片上,并获得从CLKOUT垫。该CY2309具有两个银行的每个四个输出,它可以是通过如图所示的“选择输入的选择
输入端的控制解码“第3页上的表。如果所有的输出时钟是不需要的,BankB可三态的。选择输入还允许输入时钟
被直接施加到输出端为芯片和系统测试目的。该CY2305和CY2309的PLL进入掉电模式时,还有在REF输入没有上升
沿。在这种状态下,输出三态并且PLL被关断,从而导致小于25.0μA电流消耗这些零件。该CY2309 PLL在一个另
外的情况下关闭,如图中的表所示。多CY2305和CY2309设备可以接受相同的输入时钟和分发。在这种情况下,输
出之间的偏斜的两个设备被保证是小于700 ps的。该CY2305 / CY2309有两个/三个不同的可的配置,如图中的订
购信息(第10页) 。该CY2305-1 / CY2309-1是基部。该CY2305-1H /CY2309-1H是-1的高驱动版本,它的兴起和
下降时间小于-1的速度要快得多。
CY2305SXC-1HT 概述如下:
该CY2309是设计成一种低成本3.3V零延迟缓冲器分配高速时钟,并采用16引脚SOIC或TSSOP封装。该CY2305是的8
引脚版本CY2309 。它接受一个参考输入,并驱动了5低偏移时钟。每个器件的-1H版本在向上操作以100- / 133
MHz的频率,并具有传动比更高-1设备。所有部件具有片上PLL的哪个锁定到输入时钟REF引脚。 PLL反馈是在芯
片上,并获得从CLKOUT垫。该CY2309具有两个银行的每个四个输出,它可以是通过如图所示的“选择输入的选择
输入端的控制解码“第3页上的表。如果所有的输出时钟是不需要的,BankB可三态的。选择输入还允许输入时钟
被直接施加到输出端为芯片和系统测试目的。该CY2305和CY2309的PLL进入掉电模式时,还有在REF输入没有上升
沿。在这种状态下,输出三态并且PLL被关断,从而导致小于25.0μA电流消耗这些零件。该CY2309 PLL在一个另
外的情况下关闭,如图中的表所示。多CY2305和CY2309设备可以接受相同的输入时钟和分发。在这种情况下,输
出之间的偏斜的两个设备被保证是小于700 ps的。该CY2305 / CY2309有两个/三个不同的可的配置,如图中的订
购信息(第10页) 。该CY2305-1 / CY2309-1是基部。该CY2305-1H /CY2309-1H是-1的高驱动版本,它的兴起和
下降时间小于-1的速度要快得多。
CY2305SXC-1HT 产品参数图如下: